基于邊界控制的安全SoC芯片硬件結構設計
所屬分類：參考設計
上傳者：aet
文檔大?。?span>479 K
標簽： 異構多核 片上總線 硬件隔離
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文檔介紹：為滿足大批量數據處理和信息安全的需要，基于通用處理器與專用密碼協處理器設計了一款異構多核安全SoC芯片。在分析了高性能SoC主要結構和安全問題的基礎上，融合安全硬件結構及邊界控制思想，設計了密碼服務區(qū)和應用開發(fā)區(qū)分離的多層安全SoC芯片硬件架構。對比不同權限電路設計方案后，采用真值表方法設計專用安全控制單元來實現兩個區(qū)域的硬件隔離，并根據SoC芯片受到的安全威脅設定安全攔截規(guī)則。采用EDA工具進行仿真實驗，結果表明安全控制單元能夠有效攔截應用開發(fā)區(qū)對密碼服務區(qū)的非法訪問，保護芯片的安全而且產生的延遲較小。
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